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首先，我仔细研究了关于电源引脚去耦电容数量和取值的建议。然而，我仍然无法严格遵循；那么多元件根本无法在物理上紧密排列在电源引脚周围，而且我实在不想焊接尺寸小于0603（即0.06英寸 x 0.03英寸，约1.6 x 0.8毫米）的元件。我只能尽力塞进了尽可能多的电容。
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其次，当我开始这个项目时，我更喜欢Verilog，最初只用SpinalHDL从VexRiscv的Scala源代码生成Verilog模块。然而在过去两年里，我越来越多地使用SpinalHDL，现在甚至在编写自己的模块时，也倾向于使用它而不是Verilog。
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第三，之前，远程节点的引用被限制在 heads、tags、notes、rad 和 cobs 这几类。
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